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CPLD类型:闪存
宏单元数:192
输入/输出线数:80
传播延迟时间:5.9ns
整体时钟设定时间:2.7ns
频率:201.1MHz
电源电压范围:2.375V to 2.625V, 3V to 3.6V
工作温度范围:0°C to +85°C
针脚数:100
封装类型:TQFP
工作温度最低:0°C
工作温度最高:85°C
逻辑芯片功能:CPLD
逻辑芯片基本号:EPM240T
可编程逻辑类型:CPLD
输入/输出接口标准:LVTTL, LVCMOS, PCI
在MAX II CPLD具有以下特点:低成本,低功耗CPLD瞬时上电,非易失体系结构待机电流低至25μA提供快速传播延迟和时钟到输出时间提供四个全局时钟有两个时钟可以从每个逻辑阵列模块(LAB)UFM方框多达8 Kbits对非易失性存储多电压内核使外部电源电压设备会3.3 V / 2.5 V或1.8 V多电压I / O接口,支持3.3 V,2.5 V,1.8 V和1.5 V逻辑电平总线型架构,包括可编程摆率,驱动能力,总线防护持,和可编程上拉电阻施密特触发器能够容忍噪声输入(每个引脚可编程)I / O是完全符合外围组件互连特别兴趣小组(PCI SIG)PCI本地总线规范,修订2.2 3.3 V工作在66兆赫支持热插拔内置联合测试行动组(JTAG)边界扫描测试(BST)电路符合IEEE标准. 1149.1-1990ISP电路,符合IEEE标准. 1532
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