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楼主: jjyy2jjyy2

[讨论] 求助,求助。网分使用疑问

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发表于 2015-5-24 19:45:28 | 显示全部楼层
criterion 发表于 2015-5-11 20:27
不准是正常的

准才叫奇迹!!

另外   量测跟仿真不准
还有一个因素   那就是你的RF频率
是否超过电感/电容的SRF


电容的等效电路与频率响应如下:





电感的等效电路与频率响应如下:





所以我们由上图可知

电感不是一直呈电感性   若频率超过SRF  就会变电容
电容不是一直呈电容性   若频率超过SRF  就会变电感


我们以串8.2pF电容为例  频率范围是700 MHz到6000 MHz




我们由上图可看到   其SRF为2562 MHz
换言之  当频率大于2562 MHz时  该电容会变电感
而由Smith Chart也证实这点
当频率小于2562 MHz时  此时是电容  确实就是按照串电容的趋势在走  
但当频率大于2562MHz时  此时是电感  反而是按照串电感的趋势在走


而由上图也知  不管频率点为何   都会有电阻
这表示你只要串联组件   不管电容或电感
其内阻就是会造成讯号损耗   
串8.2pF电容  内阻为11.5 Ohm  Insertion Loss如下图:



所以如果想要使阻抗点有所较大的移动
尽可能不要用串联小P数电容的方式
因为电容值越小   其内阻越大  亦即Insertion Loss会越大



同理  你要使阻抗点有所较大的移动
尽可能不要用串联大n数电感的方式
因为电感值越大   其内阻越大  亦即Insertion Loss会越大
况且根据ZL = jwL的公式 L值越大  感抗越大
如此一来  其Insertion Loss会更大



再以并27nH的电感为例



由上图可知  其SRF为2036 MHz
当频率小于2036 MHz时  此时是电感  确实就是按照并电感的趋势在走  
但当频率大于2036MHz时  此时是电容  反而是按照并电容的趋势在走


当然   有些方案  并不是为了调阻抗位置  例如:

串大P数电容 => 在不影响阻抗情况下  当DC Block
串小n数电感 / 并小P数电容 / 并大n数电感 => 在不影响阻抗情况下  使阻抗收敛

而电容跟电感的SRF   都跟其值成反比
换言之
电容值越大   其SRF越低   越容易变电感性
电感值越大   其SRF越低   越容易变电容性
因此上述串大P数电容   跟并大n数电感的方案
是否会因
电容变电感性   电感变电容性
使得阻抗偏掉??  反而使阻抗难以预测??



答案是不会!

以串联100 pF的电容为例  当频率点超过SRF时   
会变成电感在主宰  




但实际上  即便是0.5nH的ESL在主宰   其阻抗依旧不动如山啊






再以并联100 nH的电感为例  当频率点超过SRF时   
会变成电容在主宰  



但实际上   即便是0.34pF的EPC在主宰  其阻抗依旧不动如山啊




因为其电容的ESL  或电感的EPC
多半都很小   
因此串大P数电容  与并大n数电感
即便过了SRF
也顶多是变成串小n数电感   与并小p数电容
而这两个情况  不会剧烈改变你的阻抗
因此  串大P数电容   跟并大n数电感的方案
不管频率点为何? 有无过SRF   其阻抗都是不动如山的


但并大n数电感时   要特别注意
因为这是为了加强阻抗收敛用的
所以虽然不管频率点为何  其阻抗都是不动如山的
但若让频率点过了SRF  此时变电容性  那么可能收敛度会变差


而串大P数电容  当DC Block  则比较没这疑虑
因为不管频率点为何? 有无过SRF  都是有DC Block的功用


而有个特别案例  那就是Duplexer ANT端的落地电感





这是由于Duplexer的封装结构特性,会使其成电容性,
因此常看到Duplexer输出端,会摆放一颗落地电感,
来抵消其封装所造成的电容性,以加强其S11的收敛度,
亦即Duplexer的输出端,看出去需为一个电感性负载。如下图:



因此这颗电感  必须与Duplexer视为一体  不能以匹配组件来看待
所以该落地电感的值   必须遵照厂商的建议值   不能随便乱调
若值调大了  SRF往低频移动  可能会使频率点座落在SRF右边  
此时呈电容性   那阻抗收敛程度会大为降低
若值调小  有可能因电感性不足以抵销其Duplexer封装所造成的电容性,
以至于阻抗收敛程度    依旧大为降低
所以不能随便乱调


至于小P数电容   与小n数电感  因为值小
所以SRF很大  频率点几乎只会在其SRF的左边
不会电容变电感   电感变电容


当然  而由以上分析可知    频率点越高   例如WiFi 5G
其频率点座落在SRF右边的机会越高
加上其PCB的寄生效应会更为严重
因此阻抗会更难预测




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发表于 2015-8-14 16:44:01 | 显示全部楼层
jjyy2jjyy2 发表于 2015-5-4 22:00
搞了半天终于穿上来了

有没有具体操作,多谢大牛!
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发表于 2015-8-14 17:16:10 | 显示全部楼层
校准仪器还有射频线要做端口延伸,这样就会遵循那个规律
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发表于 2015-10-10 10:03:05 | 显示全部楼层
太牛逼的分析,学到了!
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发表于 2015-10-11 20:20:37 | 显示全部楼层
感觉楼主描述的不太清楚,测量的是pa输出到测试座,但好像没说明动的是哪个位置的器件?另外矢网上的图是从那边看过去的?
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发表于 2015-10-12 10:11:07 | 显示全部楼层
jjyy2jjyy2 发表于 2015-5-5 15:44
不是滤波器的匹配,就是很简单的PA输出端到天线端。我不知道为什么串联电感怎么不是顺时针转呢。。

pa输出到天线,你中间没加双工器?
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发表于 2016-9-11 11:44:38 | 显示全部楼层
太经典了
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发表于 2016-9-12 08:03:10 | 显示全部楼层
学习了。
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发表于 2016-9-12 08:37:38 | 显示全部楼层
点点法,应该是不错的方法
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