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[FPGA资料] CPLD设计实例

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发表于 2008-11-9 17:46:25 | 显示全部楼层 |阅读模式
【文件名】:08119@52RD_CPLD设计实例.rar
【格 式】:rar
【大 小】:2754K
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 楼主| 发表于 2008-11-9 17:46:56 | 显示全部楼层
挺好的资料,
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发表于 2008-11-14 20:49:59 | 显示全部楼层

CPLD设计实例

我不需要MAX+plusII开发环境的资料,以后在主题中添加一点关键词就好了(避免盲目地浪费感情)。那里可以找到一些简单的UML建模资料和提高CPLD时序电路可靠性及抗干扰措施的文章,请赐教。对于CPLD时序电路设计,加入“输出映象寄存器”和“更新冗余查寻”是否可以得到优于PLC和单片机的可靠性及抗干扰能力?
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