期待各位大侠帮我解惑!

dragon2002 · 发表于 2007-7-27 17:07:32

最近看夏宇闻老师的<<VERILOG 数字系统设计>>这本书,关于"10010"序列检测器这个例子有点疑惑.
下图是书中的状态转换图:
[upload=jpg]UploadFile/2007-7/07727@52RD_3.JPG[/upload]
下图是我认为的状态转换图:
[upload=jpg]UploadFile/2007-7/07727@52RD_2.JPG[/upload]

个人认为:
1.在B状态,如果序列中出现"1",说明以前出现的序列不满足要求,直接转到A状态即可;
2.在C状态,如果序列中出现"0",也说明以前出现的序列不满足要求,直接转到IDLE状态即可.
想来想去,觉得这样的状态转换图没问题.对书中另外加两个状态实在是想不通,
谢谢各位的回复!

dragon2002 · 发表于 2007-8-1 08:16:29

大家不吝赐教啊

caijianlong · 发表于 2007-8-9 10:03:00

哪要这么麻烦，你把要检测的数据打入一组REG中，然后再判断这组REG的值是否为“10010”即可。

当然，按照原来的方法是比较节俭资源的。[em10]

dragon2002 · 发表于 2007-8-10 15:39:52

这样是肯定不行的啦,如果序列是:10010010 呢?

caijianlong · 发表于 2007-8-15 15:34:00

为什么不行呢？只是出现两个脉冲而已，用状态机检测，似乎也有这个问题。

关键在于要根据协议规程来选择那个脉冲而已。

zmorphis · 发表于 2007-11-30 14:13:59

这不就是一个简单的状态机么？？？
很容易的吧~~
[em12]

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