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[FPGA资料] 帮忙看一下

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发表于 2007-4-10 15:49:17 | 显示全部楼层 |阅读模式
SUBDESIGN timer
{
   clk   :input;
   suocun:output;
}
VARIABLE
     f[3.0]:DFF;
     suocun :DFF;
BEGIN
   f[].clk=clk;
   suocun.clk=clk;
   f[].d=(!suocun)&(f[]+1);
   suocun.d=f[3]&!f[2]&!f[1]&!f[0];
END;
解析一下啊
谢谢
发表于 2007-10-12 15:15:19 | 显示全部楼层
f[]计数到8时清零
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发表于 2007-10-12 15:21:58 | 显示全部楼层
写的有点问题,作为输出怎么又能定义触发器
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