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[讨论] 各位大侠,指点一下!

发表于 2007-1-27 13:06:30 | 显示全部楼层 |阅读模式

请问我想用modelsim仿真用VHDL编写的程序,该怎么仿真呀?要不要象verilog仿真一样编写test程序?该怎么编写?

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楼主| 发表于 2007-1-27 13:06:30 | 显示全部楼层 |阅读模式

请问我想用modelsim仿真用VHDL编写的程序,该怎么仿真呀?要不要象verilog仿真一样编写test程序?该怎么编写?

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