使用FPGA的锁相环遇到问题，请大虾指点

zhq1234 · 发表于 2006-12-28 14:54:08

我用FPGA的cyclone系列芯片的锁相环倍频一时钟信号，但是从管脚输出的LVDS差分信号不是幅度相等，相位相反，请问为啥会出现这问题呢

yingxionga · 发表于 2006-12-29 17:12:44

我也遇到过同问。

gao72572 · 发表于 2007-1-11 10:47:34

[em13]

qchpanna · 发表于 2007-1-11 22:12:29

我有一个着方面资料的
不再手边

jackchen668 · 发表于 2007-4-12 23:15:56

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GRgreen · 发表于 2007-4-16 15:37:38

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