华为,大唐fpga设计资料

6799037 · 发表于 2006-12-22 17:16:41

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FPGA/CPLD数字电路设计经验分享
摘要：在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是行之有效的，通过许多设计实例证明采用这种方式可以使电路的后仿真通过率大大提高，并且系统的工作频率可以达到一个较高水平。
关键词：FPGA 数字电路时序时延路径建立时间保持时间

dyjccx · 发表于 2007-1-2 07:17:22

太贵了，降价吧！

wddfrankie · 发表于 2007-1-5 11:39:03

是啊，有点贵啊，降降价吧~

swlee0 · 发表于 2007-1-5 19:18:07

password??????/

Jerry_HUST · 发表于 2007-1-10 20:39:51

daiguile

qchpanna · 发表于 2007-1-12 10:45:23

太贵了，降价吧！

qchpanna · 发表于 2007-1-12 10:48:24

买了
不知道好不好

david_liuccy · 发表于 2007-1-24 15:47:29

就是太高了哈.

jingforhua · 发表于 2007-1-24 22:03:02

tai gui le ba !!
da jie a !

jingforhua · 发表于 2007-1-24 22:03:26

[em12]

oscawang · 发表于 2007-1-25 11:20:55

降价吧！

david_liuccy · 发表于 2007-1-24 15:47:29

就是太高了哈.

jingforhua · 发表于 2007-1-24 22:03:02

tai gui le ba !!
da jie a !

jingforhua · 发表于 2007-1-24 22:03:26

[em12]

oscawang · 发表于 2007-1-25 11:20:55

降价吧！

hisunzh · 发表于 2007-3-8 22:18:51

没有钱啊

flyfpga · 发表于 2007-3-9 22:41:13

[em07]刚到没钱

moon_hh · 发表于 2007-3-12 20:05:32

有买了的，说说怎么样？这么贵都不敢买了

xiero · 发表于 2007-3-13 13:27:39

太贵了～～～～～～

moon_hh · 发表于 2007-4-12 15:06:57

要口令啊，
是多少？请告诉

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