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[讨论] LO疑难问题,请高手指点

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发表于 2005-11-24 12:47:00 | 显示全部楼层 |阅读模式
在测试产品的过程中,经常会有spur这一项,当在某一频带过大的时候,一般都在那里tuning.
发表于 2005-11-25 12:43:00 | 显示全部楼层
<P>调整loop filter 可以调整晶振产生的spur 不过同时可能减少phnoise的性能。</P><P>调整lo电源的共给,加隔离等</P><P>调整gain block amp的输出 可以减少 lo 倍频的输出,不过由于amp不是工作在压缩的条件下,在高低温的情况下可能改变lo的输出阻抗,导致lo失锁,所以一般在做独立lo最后以及的amp都使他工作在压缩状态,可以使lo稳定。</P><P>lz 衡量一下就可以了,要一个性能好其他的性能也会改变哦</P>[em03][em03][br]<p align=right><font color=red>+5 RD币</font></p>
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发表于 2005-11-25 21:27:00 | 显示全部楼层
哦。学到了。
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 楼主| 发表于 2005-12-2 16:50:00 | 显示全部楼层
<P>谢谢jianrock,你的讲解对我很大帮助,我试着调了LO的供给电压,SPUR,果然解决了,连带的低温LO锁不住也OK了,非常感谢!~~~~</P>
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发表于 2005-12-3 12:48:00 | 显示全部楼层
<P>hoho 送我RD 币哦</P>
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 楼主| 发表于 2005-12-5 17:48:00 | 显示全部楼层
:),我要是版主就一定给你送了,有空多多指教小弟,多谢.
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发表于 2005-12-5 21:27:00 | 显示全部楼层
<P>问题回答真的很深刻,真的是高人。</P>
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 楼主| 发表于 2005-12-9 17:24:00 | 显示全部楼层
<P>再问一下,LO leakage大的时候怎样去调节,我现在修的一块产品,其它性能均可,唯一就是LO leakage值过大,我试着去TUNE了一下LO出来的POMER,但作用不大,请教各位大虾,有好的解决方法么?最好不要修了有连带反应的.谢谢!~~</P>
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发表于 2005-12-9 18:32:00 | 显示全部楼层
<DIV class=quote><B>以下是引用<I>river123</I>在2005-12-2 16:50:07的发言:</B>

<P>谢谢jianrock,你的讲解对我很大帮助,我试着调了LO的供给电压,SPUR,果然解决了,连带的低温LO锁不住也OK了,非常感谢!~~~~</P></DIV>


LO在这里是指什么东东啊?
一般就是本地振荡器的意思啊, 由锁相环构成,
它的供电还能随便改???

一般都是改环路滤波器的带宽呀.
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 楼主| 发表于 2005-12-13 12:54:00 | 显示全部楼层
<P>对呀,LO就是指本振,我所说的供给电压,其实很抽象,即晶振的频率和LO除频之后的频率进行比较,然后会得出一个VT电压值,而调节VT电压值,可以调整LO的输出频率.我也是刚开始做,知道的不多.所以请高手指点一二.</P>
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发表于 2005-12-13 17:47:00 | 显示全部楼层
<P>这个VT是PLL输出的电压,不能自己调的呀,否则还叫什么锁相环啊?</P><P>不明白.</P>
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 楼主| 发表于 2005-12-13 19:43:00 | 显示全部楼层
<P>你认为改变VT值是在改变PLL的电压么?</P><P>调整LOOP FILTER的带宽能起到些什么作用呢,请指教.</P>[em01]
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发表于 2005-12-13 20:37:00 | 显示全部楼层
<P>你还是上传你的原理图,然后我们再讨论吧,以免说的不是一个东东呀[em02]</P><P>如果你的PLL输出送到VCO的话,那这个电压就是不能瞎改的,因为它是鉴相器输出的电压,用于控制VCO相应改变频率的。</P><P>调整环路滤波的带宽,宽时,锁相速度快,近端相噪好,但杂散大;带宽窄时,锁相速度慢,近端相噪差,但杂散小。</P><P>以上是偶调PLL的经验,尤其是MOT出的PLL芯片,输出有两个脚的那种,适于后面加运放取两脚的差分信号。</P>[br]<p align=right><font color=red>+5 RD币</font></p>
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 楼主| 发表于 2005-12-14 10:09:00 | 显示全部楼层
<P>太谢谢yellowtoot了,loop filter我还没调过,因为不知如何下手;</P><P>我所调的PLL当然是送到VCO了,但也不是乱改,因为LO锁不住嘛,也就是说没有在规定的频率显示出来,所以要调整VT值.</P><P>再就是你做的PLL是数字的?还是模拟的?</P>
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发表于 2005-12-14 12:16:00 | 显示全部楼层
<P>数字,模拟的概念很模糊,分不清啊</P><P>通信中所用的位同步恢复你知道吧,那个东东也叫数字锁相环. 其输入的两个东东都是数字信号的方波,其幅度恒定.</P><P>而偶用的PLL芯片上说,也是数字锁相环, 共分频比等东东可以用数字形式往里写寄存器,但其输入的两个东东都是模拟的正弦波信号,且其幅度可大可小,只是有一个范围而已.</P><P>因此我不知道你所说的模拟锁相环是指什么样的?</P><P>能说说低估是如何改VT的吗? 它是PLL输出的电压呀, 你通过调什么东东才能调它呀?</P><P>据我所知,在失锁时,它要么处于高电压(PLL能输出的最高电压),要么处于0V(PLL能输出的最低电压),而锁定时,这个电压基本不变.</P><P>你不会是另外用电阻分压与它并联,然后将它拉高或接低吧[em13]</P>[br]<p align=right><font color=red>+5 RD币</font></p>
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 楼主| 发表于 2005-12-14 18:57:00 | 显示全部楼层
<P>当振荡器的输出频率F经过除频之后不等于晶振出来的频率F1时,鉴相器输出电压VT变化将振荡器的输出频率向F1*N方向调整,直到输出频率=F1*N,VT方才稳定,具体操作就是调整VCO的MATCH.</P><P>LO能锁住时,VT电压当然是不会有变化的,我指的是锁不住时.</P>[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2005-12-14 20:36:00 | 显示全部楼层
<DIV class=quote><B>以下是引用<I>river123</I>在2005-12-14 18:57:15的发言:</B>

<P>当振荡器的输出频率F经过除频之后不等于晶振出来的频率F1时,鉴相器输出电压VT变化将振荡器的输出频率向F1*N方向调整,直到输出频率=F1*N,VT方才稳定,具体操作就是调整VCO的MATCH.</P>
<P>LO能锁住时,VT电压当然是不会有变化的,我指的是锁不住时.</P></DIV>



"调整VCO的MATCH"是什么意思啊? 能说具体点吗?

你用的VCO是一个器件吗? 你说的MATCH是它输出的阻抗匹配? 还就是指其输入的环路滤波呀?调整环路滤波器,以使VT发生变化??
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 楼主| 发表于 2005-12-16 19:19:00 | 显示全部楼层
<P>我现在所用的VCO,既有一个集成化的,也有模拟组合的,环路滤波器就是将电压VT过滤为纯净的DC电压嘛,调节它的匹配当然可以改变VT了.</P>
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发表于 2005-12-16 21:46:00 | 显示全部楼层
<P>什么叫匹配呀?</P><P>你在台企吗? 怎么说来说去,偶都不明白啊[em13]</P><P>是不是匹配的概念,我们理解不同啊?</P><P>我理解的匹配是, 阻抗匹配.调节电路后,使反射最小,即共轭匹配.</P><P>请问你说的匹配是指什么啊? 难道你把调滤波器的频响也叫做调匹配? </P><P>另外,你一直说调匹配能改变VT, 这点我是不同苟同的.</P><P>我再强调一次, VT不是由环路滤波器决定的,而是由VCO本身的压控特性决定的,即输出什么频率,就对应什么电压VT!!!</P><P>失锁时,VT要么特别高,要么特别低,</P><P>锁定时,VT不变.</P><P>你改环路滤波是不可能改变电压VT的!! 只能改变锁定的状态,即锁定、失锁、假锁。</P>[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2005-12-22 09:48:00 | 显示全部楼层
请教:环路滤波起什么作用?我看到MTK6129仅使用一个外接1.5nf的电容?象环路滤波的具体值都是由IC本身决定的吗?
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