请问如何从一个数据流中恢复出该数据流的时钟来?

jefffree · 发表于 2006-9-11 13:39:00

编了一个固定结构的数据流,但在接收端如何用数字的方式将该数据流的时钟提取出来?要求抖动也不能太大,占空比40-60%就可以了

请大侠们提供点思路

lyman · 发表于 2006-9-23 10:21:00

你用CDR，对于不太高的时钟，没有问题[br]<p align=right><font color=red>+1 RD币</font></p>

jefffree · 发表于 2006-9-27 14:09:00

不想用CDR,会提高成本,想使用FPGA内部什么算法可否搞定

hanbing81 · 发表于 2006-10-16 20:59:00

内部带PLL的应该可以，但须本地时钟。

dengtingga · 发表于 2006-10-24 14:00:00

通过位同步提取电路,要将不归零码变为归零码,用高频的两本地时钟,组成添门和扣门,分频而得

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