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[FPGA资料] CPLD器件在时间统一系统中的应用(转载)

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发表于 2006-6-20 16:34:00 | 显示全部楼层 |阅读模式
作 者:装备指挥技术学院 李秋娜
摘 要:时间统一系统是靶场试验任务顺利完成的关键。本文介绍一种利用CPLD器件实
现的可编程的性能良好的IRIG-B码源。通过高度集成,将用于产生B码的各种门电路集成
在一个芯片中,构成一个应用系统,达到了最佳性价比。
关键词:B码源 CPLD器件 时序
引 言
  随着电子技术的发展,对遥测信号的帧结构的可编程度、集成度的要求越来越高,
用于时间统一系统的B码源的设计也趋于高度集成化。为了适应现代靶场试验任务的要求
,我们采用Altera的CPLD器件,将用于产生B码的各种门电路集成在一个芯片,通过高度
集成的系统可以用于产生标准的串行时间码向测量设备发送,测量设备对接收到的B码进
行解调能产生出系统所需的绝对时间和各种控制信号。此B码产生系统可作为基地设备检
测调试用,也可作实践教学设备。
1 IRIG-B码介绍
  在靶场试验中随着设备所需信息量的增加,对标准化时统设备要求也就越来越高,
其中关键的问题之一就是选用什么样的时间码。IRIG-B(美国靶场仪器组-B 型格式)DC时
间码以其实际优越性能,成为时统设备首选的标准码型。
  IRIG(Inter-Range Instrumentation Group)是美国靶场司令部委员会的下属机构
,称为"靶场时间组"。IRIG时间标准有两大类:一类是并行时间码格式,这类码由于是
并行格式,传输距离较近,且是二进制,因此远不如串行格式广泛;另一类是串行时间
码,共有六种格式,即A、B、D、E、G、H。它们的主要差别是时间码的帧速率不同。B码
的主要特点是时帧速率为1帧/s;携带信息量大,经译码后可获得1、10、100、1000 c/
s的脉冲信号和BCD编码的时间信息及控制功能信息;高分辨率;调制后的B码带宽,适用
于远距离传输;分直流、交流两种;具有接口标准化,国际通用。IRIG-B(DC)时间码
格式如图1所示。其帧速率为1帧/s,可将1帧(1s)分为10个字,每字为10位,每位的周期
均为10 ms。每位都以高电平开始,其持续时间分为3种类型:2 ms(如二进制"0"码和索
引标志) 、5 ms(如二进制"1"码)和8 ms(如参考码元,即每秒开始的第一字的第一位
;位置标志P0~P9,即每个字的第十位)。第一个字传送的s是信息,第二个字是min信
息,第三个字是h信息,第四、五个字是d(从1月1日开始计算的年积日)。另外,在第
八个字和第十个字中分别有3位表示上站和分站的特标控制码元(参考图1)。
发表于 2007-1-29 20:15:00 | 显示全部楼层
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