请教一个时钟信号处理问题

bffh · 发表于 2006-6-19 16:48:00

通常时钟信号是加一个22/33欧姆的电阻进行匹配。但我在一个原理图中看到一个26MHz的时钟信号，它不是经匹配电阻，而是串了一个10nF的电容、再连接到一个NC7SZU04的IN脚、然后由其OUT脚输出到FPGA，作为FPGA的一个时钟信号使用。不明白这样处理的原因是什么呢？

小虫 · 发表于 2006-6-20 08:24:00

应该是时钟晶体的负载

dune · 发表于 2006-6-23 08:28:00

<P>NC7SZU04应是时钟驱动</P><P>一般为了减小负载对时钟电路的影响，应加驱动</P>

bffh · 发表于 2006-6-23 13:17:00

可是，NC7SZU04的datasheet里面只说它是个unbuffered inverter，没有说是什么驱动啊！

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