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[讨论] 过孔的寄生电容和电感

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发表于 2012-5-8 23:19:46 | 显示全部楼层 |阅读模式
【文件名】:1258@52RD_过孔的寄生电容和电感.doc
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发表于 2013-8-26 17:44:51 | 显示全部楼层
下图是Via等效模型,可知会有寄生电感与寄生电容,




寄生电容会延长了信号的上升时间,降低了电路的速度。
或许单一个 Via 的寄生电容不大,
但若讯号多次在表层、内层、底层间做转换,等于增加Via 数目,
又由上图可知,Via 的寄生电容是采并联形式,
而并联形式的总电容,等于所有并联电容总合。
因此,或许单一个 Via 的寄生电容不大,
但数目一多,其总合的寄生电容便会对于电路速度有严重影响。




上图是常见的Via形式,1 为 Through hole,由表层直接贯穿到底层,
然而若讯号没有要从表层走到内层,则尽可能不要使用 Through hole。
因为由下图可知,
当讯号由表层,透过 Through hole 走到第二层时,会遗留第二层到第四层的 Via,产生所谓的 Stub Effect。




而由下图可知,Stub Effect 等于会多增加一个寄生电容,即总合的寄生电容变大,
因此若讯号没有要从表层走到内层,则尽可能不要使用 Through hole







至于寄生电感,也与 Pad 半径有关,半径越大,
其寄生电感越小,因此打Via时,用大一点的Pad,可降低寄生电感。
然而主要影响寄生电感的参数,还是 Via 长度,
越厚的板材,等同于 Via长度越长,自然其寄生电感也越严重。
而寄生电容与寄生电感,都与板材厚度有关,共同点都是成正比。
也就是若使用薄一点的板材,其寄生电容与寄生电感都会变小。

但今天不管Via的寄生电感或电容再小
我们必须体认一点,每个 Via,都是一个不连续面,
会有阻抗不匹配的效应,同时还会有额外的寄生电感与寄生电容,
而这些效应对于讯号完整性会有影响,因此少用为佳

其他详细原理  可参照



在此就不赘述


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发表于 2012-5-10 13:39:30 | 显示全部楼层
好贵 要赚到什么时候去啊
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发表于 2012-5-10 10:22:52 | 显示全部楼层
赚钱
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发表于 2012-5-10 09:39:29 | 显示全部楼层
写得不错
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发表于 2012-5-9 19:59:45 | 显示全部楼层
不错,学习一下
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发表于 2012-5-9 12:02:57 | 显示全部楼层
里面的内容如下:
通过上面对过孔寄生特性的分析,我们可以看到,在高速PCB设计中,看似简单的过孔往往也会给电路的设计带来很大的负面效应。为了减小过孔的寄生效应带来的不利影响,在设计中可以尽量做到:
1.从成本和信号质量两方面考虑,选择合理尺寸的过孔大小。必要时可以考虑使用不同尺寸的过孔,比如对于电源或地线的过孔,可以考虑使用较大尺寸,以减小阻抗,而对于信号走线,则可以使用较小的过孔。当然随着过孔尺寸减小,相应的成本也会增加。
2.上面讨论的两个公式可以得出,使用较薄的PCB板有利于减小过孔的两种寄生参数。
3.PCB板上的信号走线尽量不换层,也就是说尽量不要使用不必要的过孔。



【文件名】:1259@52RD_1258@52RD_过孔的寄生电容和电感.doc
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发表于 2012-5-9 11:36:11 | 显示全部楼层
顶顶顶顶顶顶顶顶顶
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发表于 2012-5-9 11:30:46 | 显示全部楼层
楼猪,抢钱啊!
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发表于 2012-5-9 11:19:07 | 显示全部楼层
学习学习
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发表于 2012-5-9 11:06:48 | 显示全部楼层
不错, 必须顶
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 楼主| 发表于 2012-5-8 23:26:13 | 显示全部楼层

阻抗匹配概念

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发表于 2012-6-12 17:58:07 | 显示全部楼层
kankan
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发表于 2013-6-14 13:50:48 | 显示全部楼层
太贵了吧。
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发表于 2013-6-26 19:50:10 | 显示全部楼层
漫天要价
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发表于 2013-8-26 19:00:53 | 显示全部楼层
PCB  LAYOUT工程师专用资料!要的朋友请下载!
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发表于 2016-10-25 10:46:03 | 显示全部楼层
学习谢谢
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发表于 2016-10-26 18:05:37 | 显示全部楼层
[em10]
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发表于 2017-8-10 14:40:00 | 显示全部楼层
[em09]
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