时钟线加一几十欧姆电阻有什么用呀？

ydc2734000 · 发表于 2006-6-8 14:29:00

<DIV class=quote>以下是引用coyu在2006-4-18 11:58:00的发言：
layout时候要注意电阻的位子,不能乱放,要靠近输出端
+1 RD币</DIV>

始端匹配的要靠近信号源端，终端匹配的要靠近负载终端

bffh · 发表于 2006-6-8 14:44:00

信号完整性的要求

wenglf9876 · 发表于 2006-6-17 16:19:00

阻抗匹配

laoqizzz · 发表于 2006-7-10 21:06:00

叫做阻尼电阻，是用来平滑时钟波形的

大卫 · 发表于 2006-7-11 11:20:00

我想是用来调整时序的,

panchao911 · 发表于 2006-7-11 13:08:00

个人认为：1.限流，防止突波进入芯片；2.降低EMI，降低波形的尖波。阻抗匹配似乎不太可能，我见过的阻抗匹配都是落地电阻，如彩色讯号RGB落地75ohm，示波器落地1M或50。[br]+3 RD币

rockylee123 · 发表于 2013-4-27 16:30:00

讲的很好，感谢

zhuoyanzheng · 发表于 2013-5-10 21:53:00

谢谢分享！！！！

as380736119 · 发表于 2013-5-22 09:30:00

信号完整性

xu3314334 · 发表于 2013-9-11 09:03:52

时钟线之间电容电阻怎么匹配啊？？？？？

yihom33 · 发表于 2013-9-11 10:08:26

我觉得根据CLK的信号质量调整阻值比较好些，一开始先用常用值或供应商的推荐值，大约22欧，测试Fail后再调

xtxdlut · 发表于 2013-9-12 22:02:07

yihom33 发表于 2013-9-11 10:08
我觉得根据CLK的信号质量调整阻值比较好些，一开始先用常用值或供应商的推荐值，大约22欧，测试Fail后再调

最好还是能量化计算一下，也有个方向。

bingbing1991 · 发表于 2013-9-15 02:50:51

加电阻和调时序有什么关系？老人们都说是阻抗匹配，我在T卡上面加过电阻可以解决少许静电丢T卡问题。

tuteng_2011 · 发表于 2014-12-2 15:00:53

学习了

lxnick · 发表于 2014-12-5 13:48:52

学习了！

qingjiaowowenge · 发表于 2015-5-13 09:13:38

学习学习

zhuangzhuang020 · 发表于 2015-5-21 09:27:36

三楼说的对

xwq · 发表于 2015-5-25 10:22:37

比较同意防止时钟信号反射的说法，平衡对地阻抗。

Boway · 发表于 2015-5-28 17:38:31

R1不等于R2的情况下，信号在R1，R2传输时会发生反射

ipromise0019 · 发表于 2015-6-9 13:22:59

赞成8楼

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