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[FPGA资料] 哪位好人帮帮忙给写个伪随机码verilog HDL 代码!

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发表于 2011-4-1 18:31:24 | 显示全部楼层 |阅读模式
我要做一个微波发射机测试设备需要一个伪随机码发生器,4.08M,码长度越长越好,我的系统时钟是16.32M的,想自己做一个但又对这方面不是很了解,希望好人给帮帮忙写个verilog HDL代码!先谢啦!!!
 楼主| 发表于 2011-4-2 11:19:50 | 显示全部楼层
大侠们给指点下呗!小弟不胜感激!
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