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52RD研发论坛»论坛 › 硬件研发论坛(Hardware R&D Forum) › SOC芯片设计 › 北大verilogHDL课件（很系统）
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[FPGA资料] 北大verilogHDL课件（很系统）

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发表于 2006-4-6 22:17:00 | 显示全部楼层 |阅读模式
北大verilogHDL课件（很系统）
【文件名】:0646@52RD_200511211030173591.rar
【格　式】:rar
【大　小】:1549K
【简　介】:
【目　录】:




数字集成电路设计入门
--从HDL到版图
于敦山
                                  北大微电子学系

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zhwang
发表于 2006-4-7 08:42:00 | 显示全部楼层
<P>强烈支持，谢谢！</P>
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cisse
发表于 2006-4-9 10:40:00 | 显示全部楼层
支持啊 希望能下来看看
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