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[资料] IIC总线上拉电阻问题

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发表于 2010-10-26 11:03:38 | 显示全部楼层 |阅读模式
【文件名】:101026@52RD_IIC总线上拉电阻问题.doc
【格 式】:doc
【大 小】:131K
【简 介】:
【目 录】:



上拉电阻阻值的确定
由于I2C接口采用Open Drain机制,器件本身只能输出低电平,无法主动输出高电平,只能通过外部上拉电阻RP将信号线拉至高电平。因此I2C总线上的上拉电阻是必须的!         
RP不宜过小,一般不低于1KΩ
一般IO 端口的驱动能力在2mA~4mA量级。如果RP阻值过小,VDD灌入端口的电流将较大,这导致端口输出的低电平值增大(I2C协议规定,端口输出低电平的最高允许值为0.4V);如果灌入端口的电流过大,还可能损坏端口。故通常上拉电阻应选取不低于1KΩ的电阻(当VDD=3V时,灌入电流不超过3mA)。
RP不宜过大,一般不高于10KΩ
由于端口输出高电平是通过RP实现的,线上电平从低到高变化时,电源通过RP对线上负载电容CL充电,这需要一定的时间,即上升时间。端口信号的上升时间可近似用充电时间常数RPCL乘积表示。
信号线负载电容(对地)由多方面组成,包括器件引脚、PCB信号线、连接器等。如果信号线上挂有多个器件,负载电容也会增大。比如总线规定,对于的400kbps速率应用,信号上升时间应小于300ns;假设线上CL为20PF,可计算出对应的RP值为15KΩ。

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点评

谢谢分享!  发表于 2014-10-6 16:21
发表于 2010-10-26 16:04:26 | 显示全部楼层
[em14]真的吗
,,呵呵
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发表于 2010-10-26 20:39:54 | 显示全部楼层
thank you!
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发表于 2010-10-26 20:36:10 | 显示全部楼层
thank you!
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发表于 2010-10-26 13:55:45 | 显示全部楼层
很好的文章?
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发表于 2010-11-1 20:37:50 | 显示全部楼层
这也收费,敲诈
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发表于 2010-11-1 16:58:32 | 显示全部楼层
很好很好
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发表于 2010-11-13 15:26:06 | 显示全部楼层
aaaaaaaaaaaa
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发表于 2010-11-25 20:09:14 | 显示全部楼层
学习一下~~~~~
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发表于 2010-11-25 20:03:01 | 显示全部楼层
学习一下~~~~~
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发表于 2010-12-29 19:33:18 | 显示全部楼层
by way
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发表于 2010-12-28 18:03:05 | 显示全部楼层
基础的知识就不要收费了咯,I2C协议有说明的.
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发表于 2010-12-28 17:05:08 | 显示全部楼层
明显不错[em02]
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发表于 2011-1-26 15:44:54 | 显示全部楼层
就这么两根线这么深的学问呢呀。 以后再怎么敢称自己是做驱动的呀?
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发表于 2011-1-26 12:53:22 | 显示全部楼层
赚点钱也好
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发表于 2011-3-2 14:16:26 | 显示全部楼层
学习 学习[em01]
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发表于 2011-4-25 12:08:25 | 显示全部楼层
为什么要钱?、、、
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发表于 2011-5-8 23:10:06 | 显示全部楼层
很好的文章~~
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发表于 2011-5-23 17:34:07 | 显示全部楼层
谢谢共享,知识无价
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发表于 2011-5-23 17:32:15 | 显示全部楼层
谢谢共享,知识无价
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