(原创交流)viterbi设计源代码(verilog)

Geraldineger · 发表于 2006-3-28 12:56:00

【文件名】:06328@52RD_(原创交流)viterbi设计源代码(verilog).rar
【格　式】:rar
【大　小】:6K
【简　介】:我自己编写的viterbi(2,1,9)译码器，可综合，仿真通过，但是占用资源太大。仅用于交流
【目　录】:无目录

zzl · 发表于 2006-4-9 21:40:00

xiexie!

六么liumeco · 发表于 2007-3-9 09:01:00

是硬判决还是软盘觉得啊？[em01]

shaogy · 发表于 2016-2-23 21:48:56

呵呵，这个程序也好意思放上来！

alphasyc · 发表于 2016-4-5 19:52:53

haohaohao

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[FPGA资料] (原创交流)viterbi设计源代码(verilog)