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[讨论] ESD中正电压和负电压有什么不一样

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发表于 2006-3-13 20:23:00 | 显示全部楼层 |阅读模式
打静电的时候,总是打接触+-8KV,气隙+-10kv,但 我不知道正电压和负电压有什么不同,为什么正负电压都要打?而且有时候正的过了,负的会不过?
发表于 2006-3-15 09:01:00 | 显示全部楼层
<P>接触我们打到+/-10,气中打到+/-15</P><P>正负原理基同反接电池的效果类似吧</P>
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发表于 2006-3-17 08:28:00 | 显示全部楼层
因为实际接触中不确定是正电荷还是负电荷呀。他们都可能对IC造成伤害。所以都打。[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2006-3-17 15:52:00 | 显示全部楼层
楼上说的对,因为正负的测试的时候,电子在pCb的运动方向不一样,所以,正负电测试时PCB(机器)抗静电能力不一样。[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2006-3-22 14:34:00 | 显示全部楼层
<P><FONT face=幼圆 size=3>靜電的累積可能是正的或負的電荷,因此靜電放電測試對同一IC腳而言是具有正與負兩種極性。對每一I/O ( Input or Output) Pin而言,HBM與MM靜電放電對IC的放電,有下列四種ESD測試組合:</P><OL><LI>PS-mode:VSS腳接地,正的ESD電壓出現在該I/O <P>腳對VSS腳放電,此時VDD與其他腳皆浮接; </P>
<LI>NS-mode:VSS腳接地,負的ESD電壓出現在該I/O <P>腳對VSS腳放電,此時VDD與其他腳皆浮接; </P><p><LI>PD-mode:VDD腳接地,正的ESD電壓出現在該I/O <P>腳對VDD腳放電,此時VSS與其他腳皆浮接; </P><p><LI>ND-mode:VDD腳接地,負的ESD電壓出現在該I/O <P>腳對VDD腳放電,此時VDD與其他腳浮接。</P></LI></OL></FONT>[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2006-3-22 14:35:00 | 显示全部楼层
<P><a href="http://www.t-esda.org/tech/esd/chap3/html/3-1.html" target="_blank" >http://www.t-esda.org/tech/esd/chap3/html/3-1.html</A></P><P>以上為參考資料</P>
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发表于 2006-3-23 19:25:00 | 显示全部楼层
<P>同意,一般正负都要打的</P><P>我们公司air 11KV </P><P>connect 7kv</P>
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发表于 2006-3-26 18:27:00 | 显示全部楼层
<DIV class=quote><B>以下是引用<I>ovftxgt74</I>在2006-3-15 9:01:00的发言:</B>

<P>接触我们打到+/-10,气中打到+/-15</P>
<P>正负原理基同反接电池的效果类似吧</P></DIV>


so surprise !
你们设计的每款机子都可以达到吗?
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发表于 2006-3-29 11:32:00 | 显示全部楼层
其实静电产生的原因就是正负电子的积累,在没有泻放通道时产生很高的电压,当附近有导体时就会相应的吸引或排斥电荷产生,导致电流的方向不同.如果电压足够大的话还会产生电火花.[br]<p align=right><font color=red>+3 RD币</font></p>
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发表于 2006-4-6 16:57:00 | 显示全部楼层
<P>个人认为:自然界中产生的静电有正负之分,而正负静电作用在电路上由于电流方向不一样,必然会存在阻抗的不一样,换句话说,打正电也许没关系,但打负电也许就会死机,所以测试的时候一定要都打的。 不知说的是否正确,请高手指教</P>[br]<p align=right><font color=red>+1 RD币</font></p>
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发表于 2006-4-10 17:46:00 | 显示全部楼层
to 5楼的:这是器件级的测试方法,不能用于手机
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