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[讨论] 为什么 在一些数据线上加一个串联电阻?

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发表于 2009-5-5 10:18:12 | 显示全部楼层 |阅读模式
为什么 在一些数据线上加一个串联电阻?
这个原理是什么?
发表于 2009-5-6 16:10:22 | 显示全部楼层
貌似是阻抗问题~~~因为以前项目上也在memory的clk上串过
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发表于 2009-5-7 09:53:46 | 显示全部楼层
阻抗匹配。。。
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发表于 2009-5-8 16:50:59 | 显示全部楼层
Hi,TIM207,能否具体讲下原理,tks!
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 楼主| 发表于 2009-5-13 15:24:47 | 显示全部楼层
以下是引用TIM207在2009-5-7 9:53:46的发言:
阻抗匹配。。。

阻抗匹配?
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发表于 2009-5-18 14:45:23 | 显示全部楼层
去毛刺,对噪声衰减
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发表于 2009-5-18 23:07:16 | 显示全部楼层
同意楼上的说法
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发表于 2009-5-20 09:51:30 | 显示全部楼层
阻抗匹配,建议看传输线原理和匹配方法
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发表于 2009-5-27 12:26:22 | 显示全部楼层
数据线两端阻抗不匹配,信号会在数据线上来回反射形成上下冲或者振铃,
串电阻就是衰减这种反射的,减弱上下冲,避免产生振铃,这个是属于信号
完整性问题,可以看一些信号完整性的书。
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发表于 2009-6-2 17:29:27 | 显示全部楼层
以下是引用tuoluo1980在2009-5-27 12:26:22的发言:
数据线两端阻抗不匹配,信号会在数据线上来回反射形成上下冲或者振铃,
串电阻就是衰减这种反射的,减弱上下冲,避免产生振铃,这个是属于信号
完整性问题,可以看一些信号完整性的书。


同意  说的很好!~其实我们做设计的时候,很少关注这些问题。
但是在大公司很注重 设计前的仿真。能够解决很多问题。
但是这些需要很长时间的积累
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发表于 2009-7-23 13:40:34 | 显示全部楼层
[em01][em01][em01][em01]
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发表于 2009-7-23 23:25:13 | 显示全部楼层
学习  学习  [em05][em05][em05][em05][em05]
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发表于 2009-7-24 08:37:47 | 显示全部楼层
学习  学习
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发表于 2009-8-4 16:37:12 | 显示全部楼层
阻抗匹配
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发表于 2009-8-9 00:27:17 | 显示全部楼层
赞同楼上的看法
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发表于 2009-9-16 15:38:40 | 显示全部楼层
baidu一下就有了,资料网上多的是
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发表于 2009-9-16 19:20:20 | 显示全部楼层
长见识了~[em01][em01][em01]
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发表于 2010-7-27 23:49:45 | 显示全部楼层
补充知识。
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发表于 2010-7-28 16:51:09 | 显示全部楼层
ddddd[em02]
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发表于 2010-7-28 20:05:11 | 显示全部楼层
学习了!
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