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[讨论] [求助]BGA出线后,线宽从5变到6mil,对阻抗影响?

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发表于 2008-12-24 15:48:11 | 显示全部楼层 |阅读模式
FT256,四层板。5mil的线引出后变成6mil,这种情况,到SDRAM阻抗怎么算啊?
发表于 2009-2-23 19:21:47 | 显示全部楼层
看来也不是所有问题都可以找到答案的,同情你啊~也同情我自己!
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发表于 2009-2-24 13:19:24 | 显示全部楼层
1mil线宽对阻抗的影响甚微
阻抗可能有连续性问题,建议线宽统一
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发表于 2009-2-26 09:01:38 | 显示全部楼层
越短影响越小
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发表于 2009-8-25 13:06:49 | 显示全部楼层
agagdsgdg
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发表于 2009-10-21 21:30:43 | 显示全部楼层
可忽略!
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发表于 2009-10-30 11:12:35 | 显示全部楼层
对于现在的bga封装设计,经常会有这种问题,尽量让5mil的线宽短,拉出bga区域,能加宽的地方就尽早加宽
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发表于 2009-11-1 21:10:21 | 显示全部楼层
个人认为5mil就可以了,干嘛换6mil呢,都是数字电路,只要频率不是很高,又不存在电流问题。可以用软件计算下,比如cadence spb中阻抗可以模拟计算的,可以调节层间距来匹配,还有要是PCB板材的介质常数不准,仿真也有误差。
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发表于 2009-11-4 09:25:30 | 显示全部楼层
可以忽略的.
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发表于 2009-11-4 11:15:07 | 显示全部楼层

EIA Standard Board Layout Drawing for BGA CCGA, CSP, and QFN 請參考

EIA Standard Board Layout Drawing for BGA CCGA, CSP, and QFN  請參考

【文件名】:09114@52RD_RecPCBdesign.pdf
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发表于 2009-11-4 11:16:05 | 显示全部楼层
NXP
【文件名】:09114@52RD_AN10778_1.pdf
【格 式】:pdf
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发表于 2009-11-25 20:37:27 | 显示全部楼层
feichanghao
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发表于 2009-12-18 09:55:13 | 显示全部楼层
顶顶,大家加油[em01][em01][em01][em01][em01][em01][em01]
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发表于 2009-12-22 15:06:37 | 显示全部楼层
先算算阻抗,看阻抗是否匹配,至于选5MIL还是6MIL线宽要看信号的阻抗需要,不放心的话做一个信号仿真。不过对于SDRAM来说频率一般不会超过100M吧,1MIL的差异也不会造成什么大的影响!
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发表于 2010-3-5 13:08:22 | 显示全部楼层
信号仿真?很早就听到这样的字眼,就是没有作过。。。看来还需要努力中!!!
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发表于 2010-5-27 10:55:54 | 显示全部楼层
学习学习
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发表于 2010-6-7 14:04:02 | 显示全部楼层
最好换是同一,不然到时速度上不去啊
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发表于 2010-6-8 13:37:25 | 显示全部楼层
有2欧左右的影响,但是这么一点影响不会对SDRAM信号造成实质性损失,可以忽略不计。
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发表于 2010-7-10 18:50:55 | 显示全部楼层
ding,ding
本文来自:我爱研发网(52RD.com) - R&D大本营
详细出处:http://www.52rd.com/bbs/Detail_RD.BBS_188424_58_1_1.html
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发表于 2015-9-9 09:18:17 | 显示全部楼层
kinpoagilent 发表于 2009-11-4 11:15
EIA Standard Board Layout Drawing for BGA CCGA, CSP, and QFN  請參考

【文件名】:09114@52RD_RecPCB ...

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