信号的上升时间是由哪些因素决定的？

skylgh · 发表于 2008-12-17 13:55:29

我现在有个时钟信号是24M的，开始我在源端和负载端都加了33p的电容，发现负载端信号的上升时间为8.6ns，后来我将这两个电容去掉，上升时间按变为2.8ns，但是回沟和过冲较大，后来把电容改为56p，发现上升时间竟然是3.0ns，而且回沟和过冲也比较小。到底上升时间受什么影响？有没有什么计算公式？

llzheng · 发表于 2008-12-18 12:49:45

这个现象涉及到两个问题，一个是容性负载瞬间供电，另一个则是电容对时钟上升沿/下降沿的影响问题。具体是由公式可以计算的，你可以查一下EMc方面的书，但要弄清楚所选择的电容的ESR，这个参数和电容值大小都是很重要的。[br]+3 RD币

llzheng · 发表于 2008-12-18 12:56:15

最后是在负载端加了一个56pf的电容还是源端和负载端都加了？

zcb2001 · 发表于 2008-12-18 19:06:12

你弄错了吧

llzheng · 发表于 2008-12-19 12:26:23

盼高手解答

skylgh · 发表于 2008-12-24 23:19:14

不好意思，确实是弄错了，后来发现原来是5.6P电容！[br]+1 RD币

playzhp · 发表于 2008-12-25 15:52:43

[em12]

slg232511 · 发表于 2008-12-30 17:04:54

线路阻抗决定了上升时间和下降时间！

线路的阻抗不单单是并些电容，但是也可以串联一些电阻！

david2rd · 发表于 2009-1-3 14:45:12

应该跟充电电容有关系

a5868 · 发表于 2009-1-5 10:04:21

RC 有关，也就是和线上的阻抗相关

xzjsap · 发表于 2009-1-5 21:48:21

不管你再源端还是负载端，这个要看你这个电路的电路通路特性：呈电容性还是电感性，
你改变容值说明通路呈电容性方向变化！用示波器调整达到要求即可！公式似乎很复杂具体查一下相关资料即可；
电容性
按e的时间常数1/2pi* RC 指数充放电变化！
电感性按e的时间常数1/2pi *LR 指数充放电变化！
俩者兼之按e的时间常数1/2pi *LCR算

[此贴子已经被作者于2009-1-5 23:30:51编辑过]

[br]+3 RD币

zhangyh0225 · 发表于 2009-2-27 11:04:26

赞一个，11楼楼主[em01]

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