ddr．布线要求

ＹＣＢＴ · 发表于 2008-7-10 09:51:07

ddr．布线要求
DDR 时钟: 线宽10mil，内部间距5mil，外部间距30mil，要求差分布线，必需精确匹
配差分对走线误差，允许在＋20mil 以内
DDR 地址、片选及其他控制线：线宽5mil，内部间距15mil，外部间距20mil，应走成
菊花链状拓扑，可比ddrclk 线长1000－2500mil，绝对不能短
DDR 数据线，ddrdqs，ddrdm 线：线宽5mil，内部间距15mil，外部间距20mil，最好在
同一层布线。数据线与时钟线的线长差控制在50mil 内。
在网上看的不知道对不对请高人指导.谢谢!

ADS2005A · 发表于 2008-7-11 12:35:02

好像比较困难啊，实现起来

ＹＣＢＴ · 发表于 2008-7-11 16:46:27

以下是引用ADS2005A在2008-7-11 12:35:02的发言：
好像比较困难啊，实现起来

我感觉也是很困难,没LAYOUT过DDR 心里没有底啊.哪个高人用过学习一下,QQ386285383
谢谢

xiao0422 · 发表于 2008-7-23 12:11:30

"最好在同一层布线“

对于多层板，相邻的地址数据线在不同层上布线，以保证信号线高频阻抗，减少耦合。

binggan8043 · 发表于 2008-7-31 00:28:12

地址线一层
数据线一层
也可以的
关键是等长处理

yongjin868 · 发表于 2008-11-4 14:33:35

理论上这样而已，实际上layout会有各种限制，不可能全部做到如此

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[讨论] ddr． 布线要求

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