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楼主: songdalong

[讨论] 专题讨论:SDRAM 时钟线、数据线、地址线、控制线走线原则问题

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发表于 2009-6-17 11:14:00 | 显示全部楼层

study

study study
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发表于 2009-8-25 12:04:00 | 显示全部楼层
楼主好人啊!
太感谢了啊[em01][em01][em01][em01]
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发表于 2009-10-16 16:38:00 | 显示全部楼层

扎实的英语是很必要的.

英语好了就是好.还有一个大家一定要熟悉一些自己经常接触的行业术语.这样读起来就省事不少啦.
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发表于 2009-11-10 16:18:00 | 显示全部楼层
真是一个不错主题,
谢谢大家,学到不少东西了。
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发表于 2010-1-28 13:03:00 | 显示全部楼层
以下是引用youngbird在2006-9-10 17:39:00的发言:



所有信号线等长(严格来说,应该是等时延)都是基于时序的要求,在时序裕度比较大,或低速率的时序,当然无所谓。
但当DDR2发展到667MHz的信号速率时,你就不得不考虑了。
理论上,PCB不需要布等长也可以,但时序裕度就可能很小,系统的不稳定性就增加。也许不少人在设计电路时都会碰到死机的问题,大多数硬件工程师会认为那是软件的问题。事实上,很多情况可能是硬件的问题。
数据线等长、地址线等长是一般要求,控制信号可以不等长,但需要在Memory Controller的设置上要根据具体的硬件设计来作一定的调整。
论坛上,还是初学者比较多。讨论的深度还是很受限的。哎……

确实如斑竹所言,一些芯片有调整控制时序的寄存器,加等待。
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发表于 2010-2-1 16:58:00 | 显示全部楼层
以下是引用youngbird在2006-9-10 17:39:00的发言:



所有信号线等长(严格来说,应该是等时延)都是基于时序的要求,在时序裕度比较大,或低速率的时序,当然无所谓。
但当DDR2发展到667MHz的信号速率时,你就不得不考虑了。
理论上,PCB不需要布等长也可以,但时序裕度就可能很小,系统的不稳定性就增加。也许不少人在设计电路时都会碰到死机的问题,大多数硬件工程师会认为那是软件的问题。事实上,很多情况可能是硬件的问题。
数据线等长、地址线等长是一般要求,控制信号可以不等长,但需要在Memory Controller的设置上要根据具体的硬件设计来作一定的调整。
论坛上,还是初学者比较多。讨论的深度还是很受限的。哎……



理论是参考的目标!巧妙的利用理论,尽可能的向理论方向靠!从整体出发,对待控制信号等一些特殊线特殊处理
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发表于 2010-6-13 12:25:00 | 显示全部楼层
什么都没有!
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发表于 2010-6-23 14:45:00 | 显示全部楼层
最近在看这方面的东西,好帖子,顶起[em01]
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发表于 2010-6-24 16:53:00 | 显示全部楼层

专题讨论:SDRAM 时钟线、数据线、地址线、控制线走线原则...

楼主的资料挺好的
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发表于 2010-7-7 22:50:00 | 显示全部楼层
以下是引用mikall在2009-2-6 16:17:00的发言:


阻抗匹配是用来消除反射的。如果主芯片和SDRAM之间距离比较近,即使反射也不会影响很大(前一个BIT的反射消失,下一个BIT才有效)
这是可以不用做阻抗匹配。到底做不做是针对具体应用的。


赞同!
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发表于 2010-7-25 21:17:00 | 显示全部楼层
学习了啊
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发表于 2010-8-9 17:02:00 | 显示全部楼层
学习学习
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发表于 2010-9-15 13:31:00 | 显示全部楼层
不错,学习中[em01]
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发表于 2010-9-28 15:53:00 | 显示全部楼层
所谓的等长是指满足一个范围的,我觉得最好还是把IC内部的PACKAGE LENTH考虑进去比较好!
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发表于 2013-12-17 17:11:58 | 显示全部楼层
虽是很老的资料,但还是很感谢楼主的分享。
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发表于 2014-6-13 09:31:42 | 显示全部楼层
先收藏着,呵呵。。。
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发表于 2014-6-18 09:01:16 | 显示全部楼层
[em01]学到东西了
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发表于 2014-8-8 10:43:39 | 显示全部楼层
等长的误差大小和跑的频率有关,一般同组数据线误差在25mil,地址和控制线,时钟线误差在200mil,都不会有问题的
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发表于 2014-8-20 16:35:33 | 显示全部楼层
说的太好了,一直感觉高速信号走线很神秘,看完之后感觉都差不多。
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发表于 2014-9-2 17:58:54 | 显示全部楼层
xuthus 发表于 2006-9-6 20:22
在布SDRAM线时, 主要是要把数据线走成等长, 地址线等长很少见, 控制线等长,个人觉的根本就不需要!

个人认为。其实不然。在一根线上只要是高速跳变的信号,(或者是相互依存的信号;对等的关系)都应该注意其线上波形的上升沿和下降沿而出现的过冲 欠冲问题。 这样会导致理想的波形产生畸变,严重时导致接收端无法识别数据。
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