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[IC设计资料] verilog_parameter

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发表于 2006-11-8 19:52:59 | 显示全部楼层 |阅读模式
穷死我了,同志们那表怪我
【文件名】:06118@52RD_HDL_Parameters.pdf
【格 式】:pdf
【大 小】:83K
【简 介】:verilog的parameter
【目 录】:Abstract
Creating reusable models typically requires that
general-purpose models be written with re-definable
parameters such as SIZE, WIDTH and DEPTH.


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