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[FPGA资料] 大规模集成电路HDL设计的风格和技巧

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发表于 2006-10-7 16:55:00 | 显示全部楼层 |阅读模式
【文件名】:06107@52RD_大规模集成电路HDL设计的风格和技巧_03.doc
【格 式】:doc
【大 小】:3382K
【简 介】:
【目 录】:



在使用HDL语言进行实际的超大规模集成电路的设计过程中,由于语言的句法、综合工具以及系统对电路本身的要求等因素的限制,加上至今没有形成一个系统的算法。因此,对不同器件或电路进行建模,甚至是对同一器件或电路在不同要求下建模的时候,都会出现语言结构上的多样化。本文针对这种情况提出了设计风格和设计技巧的概念,并以具体的Verilog HDL模型为例,对此作出了相应的解释。

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