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[讨论] DCDC SW端的波形看不明白 请教大神

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发表于 2016-12-10 09:40:30 | 显示全部楼层 |阅读模式
看不懂 为什么还有很长段0V电平,那路正玄波是怎么动作出来的

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发表于 2016-12-14 10:16:58 | 显示全部楼层
  这段正弦波应该是上下两个mos管同时关闭了,存在死区的情况。
  低电平是low side的mos打开时的情况,SW脚被拉到GND, 当low side mos突然关闭,因为电感中的电流无处释放,所以就产生了后面的阻尼振荡。
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发表于 2016-12-10 15:20:53 | 显示全部楼层
谐振了都。
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 楼主| 发表于 2016-12-12 08:45:18 | 显示全部楼层

怎么说 可以说的详细点吗
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发表于 2016-12-12 09:18:23 | 显示全部楼层
后面有没有带负载
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发表于 2016-12-12 10:37:58 | 显示全部楼层
。。。。这个电源废了
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发表于 2016-12-12 16:20:06 | 显示全部楼层
有些芯片轻载或没接负载有这种可能
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发表于 2016-12-12 16:41:18 | 显示全部楼层
测试点在电感前面,低边开关导通不应该就是0吗。
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发表于 2016-12-13 15:45:35 | 显示全部楼层
轻载工作再skipping mode
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 楼主| 发表于 2016-12-15 08:31:58 | 显示全部楼层
panzhang 发表于 2016-12-12 09:18
后面有没有带负载

有带负载的 接在CPU上面
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发表于 2016-12-16 08:20:42 | 显示全部楼层
说不清楚
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发表于 2016-12-16 09:08:42 | 显示全部楼层
测试方法就是错误的,这么多人回复可能存在的问题,楼主也不冒个泡!
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