信号完整性基础

Suwn_xue · 发表于 2012-2-23 10:20:15

发现还有很多资料想下，却没有RD币，
故把自己认为手上比较好的资料于大家共享，
很好的理论知识，相信一定会对你有所帮助。

1．信号完整性（Signal Integrity）
信号完整性是指信号在信号线上的质量。信号具有良好的信号完整性是指当在需要的时候具有所必需达到的电压电平数值。
2．传输线（Transmission Line）
传输线是一个网络（导线），并且它的电流返回到地或电源。
3．特性阻抗（Characteristic Impedance）
组成信号传输回路的两个导体之间存在分布电感和分布电容，当信号沿该导体传输时，信号的跃变电压（V）和跃变电流（I）的比值称为特性阻抗（Z0），即Z0=V/I。
4．反射（Reflection）
反射就是在传输线上的回波。信号功率（电压和电流）的一部分传输到线上并达到负载处，但是有一部分被反射了。如果源端与负载端具有相同的阻抗，反射就不会发生。
5．串扰（Crosstalk）
串扰是两条信号线之间的耦合。信号线之间的互感和互容引起线上的噪声。容性耦合引发耦合电流，而感性耦合引发耦合电压。
6．过冲（Overshoot）
过冲就是第一个峰值或谷值超过设定电压。对于上升沿是指最高电压，而对于下降沿是指最低电压。过分的过冲能够引起保护二极管工作，导致过早地失效。
7．下冲（Undershoot）
下冲是指下一个谷值或峰值。过分的下冲能够引起假的时钟或数据错误（误操作）。
8．电路延迟
指信号在器件内传输所需的时间（Tpd）。例如，TTL的电路延迟在3 ~ 20nS 范围。
9．边沿时间
器件输出状态从逻辑低电平跃变到高电平所需要的时间（信号波形的10~90%），通常表示为上升沿（Tr）。器件输出状态从逻辑高电平下降到低电平所需要的时间（信号波形的90~10%），通常表示为下降沿（Tf）。
10．占空比偏斜
信号传输过程中，从低电平到高电平的转换时间与从高电平到低电平的转换时间之间的差别，称为占空比偏斜。TTL和CMOS信号的占空比偏斜问题较为突出，主要是因为其输出的上升沿和下降沿延迟不同。
11．输出到输出偏斜
同一器件不同输出引脚之间的信号延迟差别，称为输出到输出偏斜。
12．器件到器件偏斜
由于制造工艺和使用环境的变化，造成的不同器件对应引脚之间的信号延迟差别，称为器件到器件偏斜。通常，器件之间的偏差远大于其他类型的偏斜。
13．动态偏斜
主要是指由于温度变化、地或电源噪声造成阀值电平随时间漂移，从而产生信号延迟的变化。

【文件名】:12223@52RD_信号完整性终稿.doc
【格　式】:doc
【大　小】:1612K
【简　介】:
【目　录】:

duanyun · 发表于 2012-2-28 11:14:20

很好，支持

zorone · 发表于 2012-3-14 19:49:40

下来学习

ma6jia · 发表于 2012-3-22 11:06:37

学习一下

lishaoce_524 · 发表于 2012-3-19 20:47:05

希望了解学习下！

uuu287 · 发表于 2013-12-11 15:26:25

thank you for your information

SaberDove2013 · 发表于 2013-12-11 17:50:13

haodongxiya

yuchao89966 · 发表于 2013-12-21 16:30:50

一边买资料，一边回复赚钱

wangyongjiking · 发表于 2014-6-25 11:09:05

学到了！！！！

SaberDove2013 · 发表于 2014-6-29 17:04:47

thank you for your information

xiaobaiyang3 · 发表于 2014-6-30 23:33:20

学习学习

a20070296 · 发表于 2015-7-26 22:58:31

thank you for your information

Vanzotest · 发表于 2015-7-27 09:14:41

very good

hejunde0 · 发表于 2015-7-28 15:42:04

很好，支持

123027527 · 发表于 2015-7-28 23:42:11

很好，支持

yemengdaojia · 发表于 2015-8-4 23:43:01

thank you

Zyuan · 发表于 2015-9-29 13:46:46

学习一下先

ctmoon · 发表于 2015-9-29 17:17:42

学习一下

bujunbuzhiying · 发表于 2015-12-7 23:04:19

学习学习

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