FPGA经验谈－牛人写

wrenhawk · 发表于 2007-6-12 01:07:00

见过很多次了

forestwolf · 发表于 2007-6-24 22:31:00

投资。。。。。。。。。[em01]

vfdff · 发表于 2007-6-27 00:28:00

大唐的那个吗？？

lgb99 · 发表于 2007-7-4 22:20:00

那我也下载

zhjr1220 · 发表于 2007-7-22 09:39:00

看看

iamhys · 发表于 2007-7-28 09:34:00

kankanwoyouduoshaoqian

mysee_liu · 发表于 2007-7-31 09:33:00

网上有

muyixia0202 · 发表于 2007-10-14 15:29:00

There is no rds! Ahmm...

zzzte · 发表于 2008-8-21 10:50:00

[em08], [em05]

starliu · 发表于 2008-10-22 17:28:00

穷，买不起。。。

xinyu1231 · 发表于 2009-2-3 16:45:00

[QUOTE]以下是引用philomena66在2006-4-18 16:34:00的发言：

【文件名】:06418@52RD_fpga经验谈(西安大唐电信).rar
【格　式】:rar
【大　小】:967K
【简　介】:摘要：在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL 电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是行之有效的，通过许多设计实例证明采用这种方式可以使电路的后仿真通过率大大提高，并且系统的工作频率可以达到一个较高水平。
关键词：FPGA 数字电路时序时延路径建立时间保持时间

【目　录】:
1 数字电路设计中的几个基本概念
2 FPGA/CPLD 中的一些设计方法

入门教程

【文件名】:0923@52RD_0817@52RD_Verilog HDL 入门教程.pdf
【格　式】:pdf
【大　小】:289K
【简　介】:
【目　录】:

[/UseMoney]

yyneuq2008 · 发表于 2010-1-29 16:04:00

谢谢楼主了

andyzb · 发表于 2012-3-15 00:24:00

目前还花销不起啊。。。。

hopezheng36 · 发表于 2012-5-22 14:47:00

大唐的那个吗？？

hopezheng36 · 发表于 2012-5-22 14:47:00

大唐的那个吗？？

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