PNP电路求助

fk1209

电路如图，信号从D1 的1脚输入，Q2的3脚输出
信号实测波形中Q1 基极为何出现上冲，而且其低脉冲也未达到0.6V，造成Q1集电极输出信号错误
大家给指点下<img src="attachments/dvbbs/2011-4/2011419002815657.jpg" border="0" onclick="zoom(this)" onload="if(this.width>document.body.clientWidth*0.5) {this.resized=true;this.width=document.body.clientWidth*0.5;this.style.cursor='pointer';} else {this.onclick=null}" alt="" />
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simple_happy

D1的1输入高电平时，Q1截止，同时给CE1 充电；
D1的1输入低电平时，CE1通过D2（压降）放电，Q1导通。
应该是这样吧？

zhouyulu

你这电路的目的是啥？D1输入高电平信号时，Q1会延迟导通，后面两个共发射极电路，放大电压，你的波形和电路图配啊，

fk1209

电路的目的是将D1的1脚端高电压信号转到3.3V上。
按理论来说，Q1的1脚高电平也不应该比D1的1脚高，而且低电平时，也应该比CE的1脚电平低1.4V左右，但实际波形相差挺大的

fk1209

另外，Q1的3脚输出波形受R2、R8、R13的影响很大，不知道需要怎么选择各个电阻的合适阻值

zhouyulu

以下是引用fk1209在2011-4-21 21:32:40的发言：
电路的目的是将D1的1脚端高电压信号转到3.3V上。
按理论来说，Q1的1脚高电平也不应该比D1的1脚高，而且低电平时，也应该比CE的1脚电平低1.4V左右，但实际波形相差挺大的

如果只是这个目的，你干吗不用level shift电路呢？这个电路搞的这么负责，从你波形图上看，Q1.1的电压比D1.1的电压低、