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[讨论] 避免竞争冒险的消去项

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发表于 2008-9-19 16:44:17 | 显示全部楼层 |阅读模式
看资料说,在组合逻辑中,对可能产生的竞争和冒险,解决方法:一是添加布尔式的消去项,二是在芯片外部加电容。
这个“布尔式的消去项”,如何从代码形式和综合后的逻辑器件来看待呢?(即若是用代码形式来表示,是不是再加一个使能电平什么的;从综合后的逻辑器件来看是不是就多了一个与门呢),呵呵,又多一个与门,更复杂的组合逻辑,会不会恶性循环呀。请大家赐教解惑。谢谢!
发表于 2008-9-23 10:44:53 | 显示全部楼层
TMD黑
本文来自:我爱研发网(52RD.com) 详细出处:http://www.52rd.com/bbs/dispbbs.asp?boardid=95&id=137288&star=1#92501
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发表于 2008-9-24 12:51:35 | 显示全部楼层
解决竞争冒险的方法很多:
1:添加布尔式的消去项,,修改卡诺图,增加多余项,在卡诺图的两圆相切处增加一个圆,可以消除逻辑冒险。但该法对于计数器型产生的毛刺是无法消除的;
2:取样法:由于冒险出现在变量发生变化的时刻,如果待信号稳定之后加入取样脉冲,那么就只有在取样脉冲作用期间输出的信号才能有效。这样可以避免产生的毛刺影响输出波形;
3:吸收法:增加输出滤波,在输出端接上小电容! 可以滤除毛刺,但输出波形的前后沿将变坏,在对波形要求较严格时,应再加整形电路,该方法不宜在中间级使用。
4:延迟办法:因为毛刺最终是由于延迟造成的,所以可以找出产生延迟的支路。对于相对延迟小的支路,加上毛刺宽度的延迟可以消除毛刺。但有时随着负载增加,毛刺会继续出现,因而这种方法也是有局限性的。而且采用延迟线的方法产生延迟更会由于环境温度的变化而使系统变不可靠;
5:锁存法:当计数器的输出进行相“与”或相“或”时会产生毛刺。随着计数器位数的增加,毛刺的数量和毛刺的种类也会越来越复杂,可通过在输出端加. 触发器加以消除。

对于一般情况下产生的毛刺,可以尝试用D触发器来消除。但用D触发器消除时,有时会影响到时序,需要考虑很多问题。所以要仔细地分析毛刺产生的来源和毛刺的性质,采用修改电路或其它办法来
彻底消除。
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