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[资料] IC入门

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发表于 2008-8-22 21:53:49 | 显示全部楼层 |阅读模式
很不错
【文件名】:08822@52RD_IC入门.doc
【格 式】:doc
【大 小】:64K
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发表于 2008-8-23 10:04:22 | 显示全部楼层
讲述一下内容
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发表于 2008-8-23 15:42:23 | 显示全部楼层
LZ不知道发贴的规矩么,小心斑竹扣币哦[em01]
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发表于 2009-7-24 09:59:04 | 显示全部楼层

怎么又要钱啊,没钱啦。

怎么又要钱啊,没钱啦。
本文来自:我爱研发网(52RD.com) 详细出处:http://www.52rd.com/bbs/Post.asp?action=re&BoardID=104&ID=135690&star=1&page=1
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发表于 2009-8-8 16:51:43 | 显示全部楼层
楼上的楼上这么钱  令人艳羡  买不起老[em03]
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发表于 2009-8-27 17:27:59 | 显示全部楼层
[em10][em11]
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发表于 2009-9-12 10:28:37 | 显示全部楼层
没钱哟!
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发表于 2010-2-1 19:48:11 | 显示全部楼层
呵呵
好东西
[em02]
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发表于 2010-2-4 15:06:34 | 显示全部楼层
[em07]都不知道大概内容...这钱该花不花也不知道...
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发表于 2010-4-29 10:21:46 | 显示全部楼层
具体是什么内容啊?
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发表于 2010-5-22 13:40:25 | 显示全部楼层
下载学习学习[em02]
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发表于 2010-6-3 21:31:39 | 显示全部楼层
请教:做IC设计需要具备哪些知识
你可以先从数字电路入手,一开始就学模拟的话就得看你功底如何了?数字电路那些基本的东西还是要弄会,电子电路、逻辑设计、计算机组织机构等,再看看VLSI设计,verilog语言、test、还有layout都学完后最好能跟着做几个实际的东西,基本上可以摸爬滚打了。
IC设计中一般会用到的有Cadence的电路输入工具Virtuoso schematic composer,仿真和验证工具NC-Verilog® simulator,Cadence ®  Verifault(R)-XL simulator.还有Synopsys的RTL级仿真工具Scirocco Simulator,VERA Developers Kit,混合信号仿真的工具有St-Hspice,Star-Hspice with Scanwaves等,还有很多别的综合工具、测试工具、版图工具、全定制工具等。
前端与后端

公司里边的IC设计流程是一个带循环的过程,一般来说,Layout、布局布线、产品测试等这些都是后端工作,产品定义、逻辑设计、代码编写、仿真验证、自测试设计、综合等工作都是前端工作,前端和后端设计在有的公司又分的很细,每人只负责一小部分,但这些工作决不是割裂开的,除了精通自己的专长,工程师必须还要懂的别的工序和别的模块的设计原理和设计方法,否则在强调团队合作和配合的公司,你的东西人家不知如何测试或不知怎样集成,就是非常麻烦的事情。所以在一开始设计的时候就需要综合考虑这些东西。

应该说走混合设计

应该说走混合设计,总的来说模拟比较难,因为涉及速度,功耗,增益,精度,阻抗匹配,电源电压,等等。而数字就速度和功耗的折中。现在的趋势在信号处理方面,数字趋向主流,但模拟在某些领域反而热了,高速数字设计实际上是模拟设计。特别是光信号,RF等。。。

模拟设计需要基本理论功底要强,开始的时候了解一点CMOS工艺会有些帮助,了解反馈、频率补偿、电流和电压参数、基准源等基本的东西,然后要是能全面熟悉一下乘法器、放大器、滤波器、ADC/DAC等原理和设计要点,HSPICE也不可少。高手起码要懂一些测试方面的东西,否则很难跟后工序的人配合,做的东西人家不支持,老板也不会高兴啊。现在大规模的集成电路设计有一个趋势就是越来越多的用到数模混合的方法,单靠模拟做到很大比较不经济。你学了模拟后搞定数字就会比较轻松一些。能作数模混合设计的在公司肯定是个大拿啊,呵呵。不过有了这些没有实践提升就有限,不过好像我的一个同事最近去了一个什么培训,好像挺多实习的。你也可以去看看,也是一条路么。
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发表于 2010-6-3 21:34:05 | 显示全部楼层
如何提高电路工作频率

   对于设计者来说,我们当然希望我们设计的电路的工作频率(在这里如无特别说明
,工作频率指FPGA片内的工作频率)尽量高。我们也经常听说用资源换速度,用流水的

方式可以提高工作频率,这确实是一个很重要的方法,今天我想进一步去分析该如何提

高电路的工作频率。

   我们先来分析下是什么影响了电路的工作频率。

   我们电路的工作频率主要与寄存器到寄存器之间的信号传播时延及clock skew有关
。在FPGA内部如果时钟走长线的话,clock skew很小,基本上可以忽略, 在这里为了简

单起见,我们只考虑信号的传播时延的因素。

   信号的传播时延包括寄存器的开关时延、走线时延、经过组合逻辑的时延(这样划
分或许不是很准确,不过对分析问题来说应该是没有可以的),要提高电路的工作频率

,我们就要在这三个时延中做文章,使其尽可能的小。

   我们先来看开关时延,这个时延是由器件物理特性决定的,我们没有办法去改变,
所以我们只能通过改变走线方式和减少组合逻辑的方法来提高工作频率。

   1.通过改变走线的方式减少时延。
   以altera的器件为例,我们在quartus里面的timing closure floorplan可以看到有

很多条条块块,我们可以将条条块块按行和按列分,每一个条块代表1个LAB,每个LAB里

有8个或者是10个LE。它们的走线时延的关系如下:同一个LAB中(最快) < 同列或者同

行 < 不同行且不同列。
   我们通过给综合器加适当的约束(不可贪心,一般以加5%裕量较为合适,比如电路
工作在100Mhz,则加约束加到105Mhz就可以了,贪心效果反而不好,且极大增加综合时

间)可以将相关的逻辑在布线时尽量布的靠近一点,从而减少走线的时延。(注:约束

的实现不完全是通过改进布局布线方式去提高工作频率,还有其它的改进措施)

   2.通过减少组合逻辑的减少时延。
   上面我们讲了可以通过加约束来提高工作频率,但是我们在做设计之初可万万不可
将提高工作频率的美好愿望寄托在加约束上,我们要通过合理的设计去避免出现大的组

合逻辑,从而提高电路的工作频率,这才能增强设计的可移植性,才可以使得我们的设

计在移植到另一同等速度级别的芯片时还能使用。
   我们知道,目前大部分FPGA都基于4输入LUT的,如果一个输出对应的判断条件大于
四输入的话就要由多个LUT级联才能完成,这样就引入一级组合逻辑时延,我们要减少组

合逻辑,无非就是要输入条件尽可能的少,,这样就可以级联的LUT更少,从而减少了组

合逻辑引起的时延。
   我们平时听说的流水就是一种通过切割大的组合逻辑(在其中插入一级或多级D触发

器,从而使寄存器与寄存器之间的组合逻辑减少)来提高工作频率的方法。比如一个32

位的计数器,该计数器的进位链很长,必然会降低工作频率,我们可以将其分割成4位和

8位的计数,每当4位的计数器计到15后触发一次8位的计数器,这样就实现了计数器的切

割,也提高了工作频率。
   在状态机中,一般也要将大的计数器移到状态机外,因为计数器这东西一般是经常
是大于4输入的,如果再和其它条件一起做为状态的跳变判据的话,必然会增加LUT的级

联,从而增大组合逻辑。以一个6输入的计数器为例,我们原希望当计数器计到111100后

状态跳变,现在我们将计数器放到状态机外,当计数器计到111011后产生个enable信号

去触发状态跳变,这样就将组合逻辑减少了。

   上面说的都是可以通过流水的方式切割组合逻辑的情况,但是有些情况下我们是很
难去切割组合逻辑的,在这些情况下我们又该怎么做呢?

   状态机就是这么一个例子,我们不能通过往状态译码组合逻辑中加入流水。如果我
们的设计中有一个几十个状态的状态机,它的状态译码逻辑将非常之巨大,毫无疑问,

这极有可能是设计中的关键路径。那我们该怎么做呢?还是老思路,减少组合逻辑。我

们可以对状态的输出进行分析,对它们进行重新分类,并根据这个重新定义成一组组小

状态机,通过对输入进行选择(case语句)并去触发相应的小状态机,从而实现了将大的

状态机切割成小的状态机。在ATA6的规范中(硬盘的标准),输入的命令大概有20十种

,每一个命令又对应很多种状态,如果用一个大的状态机(状态套状态)去做那是不可

想象的,我们可以通过case语句去对命令进行译码,并触发相应的状态机,这样做下来

这一个模块的频率就可以跑得比较高了。

   总结:提高工作频率的本质就是要减少寄存器到寄存器的时延,最有效的方法就是
避免出现大的组合逻辑,也就是要尽量去满足四输入的条件,减少LUT级联的数量。我们

可以通过加约束、流水、切割状态的方法提高工作频率。
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发表于 2010-6-3 21:36:36 | 显示全部楼层
copy 一半 买来文档到这里。

参考给大家。
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发表于 2010-6-4 12:44:32 | 显示全部楼层
谢谢,学习了
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发表于 2010-6-6 09:45:07 | 显示全部楼层
讲述一下内容
本文来自:我爱研发网(52RD.com) - R&D大本营
详细出处:http://www.52rd.com/bbs/Detail_RD.BBS_135690_104_1_1.html
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发表于 2010-7-21 17:41:28 | 显示全部楼层
不错,学习学习
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发表于 2010-7-23 14:01:32 | 显示全部楼层
楼主好人,资料挺好的
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