[提问] 关于always块语句中顺序和并行语句

nicerain · 发表于 2008-7-26 09:03:34

Verilog中的语句一般都是由begin...end块语句来连接的，而begin...end块语句是串行语句，但是在此语句中的非阻塞语句又是并发执行的，这样矛盾吗？

aleilee · 发表于 2008-7-29 23:11:43

begin...end只是表明一个块的起始，并没有表明之间的语句都是串行的。所以并不矛盾
[em01]

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