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[讨论] 已经设计好原理图后,在PCB layout 中為減小電磁干擾應还应该注意些什麼問題呢?

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发表于 2007-11-29 10:29:31 | 显示全部楼层 |阅读模式
大家踊跃发言哦!一块总结经验,一起进步
发表于 2007-11-29 14:54:02 | 显示全部楼层
太泛泛了吧?有点说不清楚了。
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 楼主| 发表于 2007-11-29 16:15:59 | 显示全部楼层
[em03],我也那麼覺得,可是我也不知道該怎麼問清楚
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发表于 2007-12-2 15:53:21 | 显示全部楼层
有三个方面的问题要注意,一是高速(5ns级别沿速率)互连线的回流设计(映像平面、回流过孔、回流电容),二是线间串扰(3W原则),三是多点接地设计(针对所有电长的金属导体). [em01][br]<p align=right><font color=red>+1 RD币</font></p>
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 楼主| 发表于 2007-12-5 14:25:31 | 显示全部楼层
謝謝樓上!麻煩能不能解釋一下呢?我看不大懂唉!
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发表于 2007-12-7 19:55:15 | 显示全部楼层
如果能一下说清楚,就难啊?减少干扰就是要注意回路走线啊。包括磁场回路干扰啊。很多滴。[em04][br]<p align=right><font color=red>+1 RD币</font></p>
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 楼主| 发表于 2007-12-11 11:54:46 | 显示全部楼层
a [em03]
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发表于 2007-12-11 15:05:10 | 显示全部楼层
高速信號的參考層也很重要
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